ダブルビア制約付きコモンセントロイド配置におけるペア対称配線手法

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  • Pair Symmetrical Routing in Common Centroid Placement with Double Via Constraints

Abstract

アナログ集積回路では，素子特性の相対精度を頼りとした設計が一般に行われる．本研究は，コモンセントロイド配置されているトランジスタを対象に，対称的な配線を生成する手法の実現を目的とする．2 層ペア対称配線において，ネット数に対して利用できる縦トラックの割合が少ない場合には，隣接端子の配線が縦トラックを共有する必要がある．我々は配線テンプレートを利用して，ペア対称配線を効率よく生成する配線手法を提案したが，配線の層間接続にはシングルビアを用いていた．本稿では，配線の信頼性を向上させるために，層間接続にダブルビアを用いる場合に用いることができるペア対称配線手法を提案する．

In analog integrated circuits, designs generally rely on the relative accuracy of device characteristics. The objective of this study is to realize a method to generate symmetric interconnections for transistors in a common centroid arrangement. 2-layer pair symmetric interconnections require adjacent terminal interconnections to share vertical tracks when the ratio of available vertical tracks to the number of nets is small. We have proposed a routing method that uses a routing template to avoid constraint violations, but single vias are used for interlayer connections. In this paper, we propose an interconnect method that uses double vias for interlayer connections to improve interconnect reliability.

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