ゲートレベルシミュレーションによるエラー検出・回復方式回路の評価
Bibliographic Information
- Other Title
-
- ゲートレベルシミュレーション ニ ヨル エラー ケンシュツ カイフク ホウシキ カイロ ノ ヒョウカ
- An evaluation of error detection/correction circuits by gate level simulation
- VLSI設計技術
- VLSI セッケイ ギジュツ
Search this article
Journal
-
- 電子情報通信学会技術研究報告 = IEICE technical report : 信学技報
-
電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 110 (432), 147-152, 2011-03
東京 : 電子情報通信学会
- Tweet
Keywords
Details 詳細情報について
-
- CRID
- 1520009407303926400
-
- NII Article ID
- 110008689558
-
- NII Book ID
- AA1123312X
-
- ISSN
- 09135685
-
- NDL BIB ID
- 11048256
-
- Text Lang
- ja
-
- NDL Source Classification
-
- ZN33(科学技術--電気工学・電気機械工業--電子工学・電気通信)
-
- Data Source
-
- NDL
- CiNii Articles
- KAKEN