ビアスイッチFPGA向け配線解析手法の検討
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- ビアスイッチ FPGA ムケ ハイセン カイセキ シュホウ ノ ケントウ
- A Study on Interconnect Delay Computation for Via-switch Based FPGA
- VLSI設計技術
- VLSI セッケイ ギジュツ
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- 電子情報通信学会技術研究報告 = IEICE technical report : 信学技報
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電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 117 (455), 187-192, 2018
東京 : 電子情報通信学会
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Details 詳細情報について
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- CRID
- 1520009407835528320
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- NII Article ID
- 40021491285
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- NII Book ID
- AA1123312X
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- ISSN
- 09135685
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- NDL BIB ID
- 028877383
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- Text Lang
- ja
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- NDL Source Classification
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- ZN33(科学技術--電気工学・電気機械工業--電子工学・電気通信)
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- Data Source
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- NDL
- CiNii Articles
