An accurate RLC interconnection delay calculation for generating RC delay equivalent circuit enclosing inductance effects
Bibliographic Information
- Other Title
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- accurate RLC interconnection delay calculation for generating RC delay equivalent circuit enclosing inductance effects
- LSI上の配線におけるインダクタンス効果を組み込んだRC等価遅延モデリング
- 特集 VLSI一般
- トクシュウ VLSI イッパン
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- 電子情報通信学会技術研究報告 = IEICE technical report : 信学技報
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電子情報通信学会技術研究報告 = IEICE technical report : 信学技報 100 (41), 19-25, 2000-05-11
東京 : 電子情報通信学会
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Details 詳細情報について
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- CRID
- 1520009410279225344
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- NII Article ID
- 110003317642
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- NII Book ID
- AA1123312X
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- ISSN
- 09135685
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- NDL BIB ID
- 5408266
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- Text Lang
- en
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- NDL Source Classification
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- ZN33(科学技術--電気工学・電気機械工業--電子工学・電気通信)
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- Data Source
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- NDL
- CiNii Articles
