インパルス性雑音環境下におけるDPLLを用いたクロック再生回路の特性

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タイトル別名
  • Performance Test and Improvement of Clock Synchronizer Using DPLL in Non-Gaussian Impulsive Noise Environment

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説明

複合雑音発生器で,2値量子化DPLLを用いたクロック再生回路の特性を実験的に調べた.その結果,インパルス雑音環境下においては,クロック再生特性の大きな劣化がみられた.DPLLの前に位相制御量を増やす回路を追加することによって,この劣化を大部軽減できることを示した.
The performance of clock synchronizer using DPLL for GMSK reception is investigated in a non-Gaussian impulsive noise channel.The result shows that non-Gaussian impulsive noise degrades the performance of the clock synchronizer significantly.A simple additional circuit in front of DPLL,however,is shown to be effective to improve the clock synchronization performance in the non-Gaussian impulsive noise channel. Key words Digital communication systems,Clock synchronizer,DPLL, Impulsive noise.

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詳細情報 詳細情報について

  • CRID
    1573387452166108928
  • NII論文ID
    110003190952
  • NII書誌ID
    AN10013108
  • 本文言語コード
    en
  • データソース種別
    • CiNii Articles

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